SystemVerilog引入了逻辑门，但目的是什么？

Question

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在SystemVerilog中是否存在可以使用logic但不用reg的区域？

我寻找了很多关于这个问题的答案，但没有找到。

- Taher Anaya

1个回答

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可以查看英文原文，
原文链接

- toolic · Answer 1

根据IEEE Std 1800-2017，第6.11.2节 2状态（两值）和4状态（四值）数据类型：

关键字reg并不总是准确描述用户意图，因为它可能被认为暗示了硬件寄存器。关键字logic是一个更具描述性的术语。logic和reg表示相同的类型。

由于它们表示相同的类型，因此它们应该是可互换的。